Phần mềm Quartus 15 cho Altera FPGA

-

Quartus: https://downloads.intel.com/akdlm/software/acdsinst/15.0/145/ib_installers/QuartusSetup-15.0.0.145-windows.exe

ModelSim: http://download.altera.com/akdlm/software/acdsinst//15.0/145/ib_installers/ModelSimSetup-15.0.0.145-windows.exe

MAX10: http://download.altera.com/akdlm/software/acdsinst/15.0/145/ib_installers/max10-15.0.0.145.qdz

Nhận xét

Đăng nhận xét

Bài đăng phổ biến từ blog này

Sự khác nhau giữa 2 giao thức SPI và I2C

-
Hình ảnh
 SPI SPI được phát triển trong thập niên 1980 bởi Motorola như là 1 cách để giao tiếp giữa những vi điều khiển đời đầu của họ với những ngoại vi onboard như là EEPROM. Motorola, cũng như bất kỳ tổ chức nào khác, duy trì bất kỳ hình thức tiêu chuẩn hóa nào của giao thức SPI. Do tiêu chuẩn "de facto" này, việc triển khai có thể khác nhau giữa các nhà sản xuất. Hãy chắc chắn rằng bạn đọc kỹ datasheet cho từng phần liên quan đến SPI!  SPI dùng 4 đường tín hiệu tích cực (không bao gồm nguồn và đất) để giao tiếp giữa các phần. - SCLK: Serial Clock (điều khiển bởi master) - MOSI: Master Out Slave In (điều khiển bởi master) - MISO : Master In Slave Out (điều khiển bởi thiết bị slave) - SS: Slave Select (điều khiển bởi master) Với 4 tín hiệu này, 1 thiết bị điều khiển (master) có thể giao tiếp với những thiết bị ngoại vi khác (slave) Kết nối SPI kiểu điểm-điểm Trong khi ta chỉ có 1 master trên SPI bus thì ta có thể thêm số lượng bất kỳ các ngoại vi. Với mỗi ngoại vi thêm vào thì ta ph
ĐỌC »

Một số nguyên tắc khi đặt tên tín hiệu, biến trong VHDL và Verilog

-
 Đây là 1 chia sẻ của 1 Digital Designer có kinh nghiệm lâu năm. Những quy tắc này được khuyến khích cho cả VHDL và Verilog để đảm bảo tính nhất quán. Ta sẽ được 3 lợi ích chính sau khi áp dụng những quy tắc này: 1. Code dễ đọc và dễ hiểu hơn 2. Cải thiện tư duy khi viết code 3. Code sẽ ít bị lỗi hơn Về vấn đề đặt tên các tin hiệu, biến: Tiền tố (Prefixes): ta sẽ thêm các tiền tố sau ở trước tên tín hiệu, biến tương ứng      i_ Input signal      o_ Output signal      r_ Register signal (has registered logic)      w_ Wire signal (has no registered logic)      c_ Constant      g_ Generic (VHDL only)      t_ User-Defined Type Tiền tố i_ và o_: Đây là phong cách quan trọng nhất mà bạn nên áp dụng! Quá nhiều kỹ sư thiết kế không cho biết tín hiệu của họ là đầu vào hay đầu ra từ một entity/mô-đun. Có thể rất khó khăn và khó chịu khi xem qua code để xác định hướng của tín hiệu. Ngoài ra, một tín hiệu được đặt tên là "data" và là một đầu ra sẽ khó tìm thấy trong mã của bạn thông qu
ĐỌC »

VHDL cơ bản 00: Giới thiệu ngôn ngữ VHDL

-
Hình ảnh
  - VHDL là một ngôn ngữ mô tả phần cứng (HDL) được sử dụng để mô tả một hệ thống thiết kế logic. Được dùng trong thiết kế CPLD hoặc FPGA, phần mềm sẽ nạp chương trình vào CPLD hoặc FPGA để có được một hệ thống logic mà chúng ta đã thiết kế. - VHDL viết tắt của VHSIC Hardware Description Language. VHSIC lại là 1 từ viết tắt của Very High Speed Integrated Circuit. VHDL là ngôn ngữ mô tả phần cứng được phát triển dùng cho chương trình VHSIC (Very High Speed Intergrated Circuit) của bộ quốc phòng Mỹ. - Hầu hết câu lệnh trong VHDL xảy ra đồng thời (song song với nhau), chứ không phải là xảy ra tuần tự như C, C++.... Điều này là một khó khăn cho những người đã quen với việc lập trình phần mềm bắt đầu lập trình VHDL. Tuy nhiên, khi đã quen với cách lập trình của ngôn ngữ mô tả phần cứng, điều này sẽ rất dễ dàng. Nên các bạn cứ yên tâm :v . - Trước khi VHDL ra đời, có nhiều ngôn ngữ mô tả phần cứng được sử dụng nhưng không có một tiêu chuẩn thống nhất. Vì các ngôn ngữ mô phỏng phần cứng đó đư
ĐỌC »